iMPACT和ChipScope是什么东西？xilinx公司的产品，他的是一种芯片的名字还是什么？_百度知道
iMPACT和ChipScope是什么东西？xilinx公司的产品，他的是一种芯片的名字还是什么？
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都是FPGA开发辅助软件，IMPACT是设置约束的，ChipScope是在线逻辑分析仪，进行信号的观察。
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打开ISE，选择File|New Project，在弹出的新建对话框中输入工程名，例如“Myproject”，并选择工程文件路径，例如“E:\Proj_FPGA\Myproject”,如下图所示，以后将以这个工程名和路径说明。选择好以后，next，需要注意以下几个选项。Famliy：选择所使用的FPGA类型；Device：选择所使用的FPGA具体型号；Synthesis Toll：选择所使用的综合工具，默认为ISE自带的XST工具； Simulator：选择仿真软件，默认是ISE自带的IPreferred Language:选择所使用的硬件语言，我们选择Verilog； 图2.1 新建工程step1后面直接点next即可，直到完成新工程的建立。 图2.2 新建工程step23．Verilog HDL代码的输入和功能的仿真
在工程管理器任意位置单击鼠标右键，在弹出的菜单中选择“New Source”命令，一般用到的是Verilog Module、IP、、Verilog Test bench选项，分别可以创建verilog模块文件、调用FPGA内部的IP核、创建测试文件。 图3.1 新建源代码对话框在示例中我们选择新建一个Verlig Module模块Proj_top作为顶层文件，直接点击Next，在这一级可以编辑模块的输入输出，也可以不设置，在以后的代码中直接指定，这里为了方便我们不设置输入输出，此后一直next直到完成。当然，以后可以新建更多模块加入到工程中，方法一样。 图3.2源代码输入创建完成后如图3.2所示，这时，我们已经创建了一个Verilog模块的例子，剩余工作就是在源文件编辑区编写代码以实现设计功能。以下是一个简单的例子。例1：利用Verilog代码实现8bit计数器
module Proj_top(
input clk,
input rst,
output reg [7:0] dout
);always @ (posedge clk) begin
if(!rst)//low act
dout <= 8'h00;
dout <= dout + 1'b1; endendmodule输入代码完成后，保存，双击过程管理区中的Synthesize XST，出现对工程进行综合。综合过程中，如在信息显示区出现error，需要根据提示查看修改代码。当工程正确无误后，该选项将变为绿色的对号（代码正确）或者黄色的感叹号（含有警告，可以忽略，需要具体分析）。 图3.3 工程的综合
图3.4测试文件的创建为了对设计程序做逻辑上的验证，一般，我们可以添加一个测试文件来验证所设计的程序的正确性。在工程管理区的View这一栏，选择Simulation，并在下面的hierarchy空白处右键NewSource，选择 Verilog Test Fixture，其创建方式其实和上面所讲的文件的创建类似。 在此示例中，我们创建一个名为“test”的测试模块。测试代码如下：
// Outputs
wire [7:0]
// Instantiate the Unit Under Test (UUT)
Proj_top uut (
.clk(clk),
.rst(rst),
.dout(dout)
initial begin
// Initialize Inputs
// Wait 100 ns for global reset to finish
// Add stimulus here
rst = 1;//add by yourself
endalways #10 clk = ~//add by yourself
endmodule这时，在工程管理区选中到测试文件名“test”上，在过程管理区中双击Simulate Behavioral Model，如果正确，运行结束将弹出仿真界面Isim。 图3.5综合测试文件 图3.6 Isim仿真界面Isim界面大体和ISE相似，下面列举几个常用的工具： 图3.6 Isim工具栏从左到右：波形放大、缩小、波形全部显示、将光标移到波形中央、刷新、光标的左移、右移、添加新光标、重新产生测试波形、一直运行、按设定的时间步进运行。
在这里可以观察波形是否和设计一致。至此，一个最简单的ISE工程从设计到逻辑验证完成。4.综合与实现
一个完整的FPGA工程，需要进行综合、实现2个过程。综合（Synthesize）:将HDL语言、原理图等设计输入翻译成由与、或、非门和RAM、触发器等基本逻辑单元连接（网表），并根据目标和要求（约束条件）优化所生成的逻辑连接，生成NGC、NCR以及LOG文件。综合之后可双击View RTL Schematic来查看门级电路；实现（Implement）：将综合输出的逻辑网表翻译为所选器件的底层模块与硬件源语，将涉及映射到器件结构上，进行布局布线，以达到在选定的器件上实现设计的目的。主要分为3步：翻译（Translate）逻辑网表、映射（Map）到器件单元、布局布线（Place&Route）； 图4.1 FPGA的综合和实现5．FPGA文件的下载在安装目录寻找打开impact，在左侧impact flow窗口中双击，然后在右面空白区域右键单击ADD Xilinx Device，选择所需加载的.bit文件，然后右侧窗口出现FPGA的绿色符号，在符号上右键单击Program，等待下载完毕。 图5.1 FPGA文件下载step1 图5.2 FPGA文件下载step2 6．添加chipscopeFPGA在线调试一般要需要用到chipscope（逻辑分析仪），这样可以实时抓取我们感兴趣的信号状态，用来分析工程的正确性。添加方式和新建Verilog文件一样，选择Chipscope Definition and Connection File。这里，创建了一个名为test的chipscope。 图6.1 新建chipscope新建完成后，在工程管理区双击test.cdc，弹出如下界面： 图6.2 chipscope配置step1Next，设置深度，默认为1k，注意勾选来设定所抓取的数据的个数，Next，设置数据存储，next，点击Modefy Connection， 图6.3 chipscope配置step2 图6.4 chipscope配置step3左上区域可以选择具体模块，左下框图中的Pattern选项中可搜索信号名，格式为“*信号名*”（引号内部），在右面的区域可以添加触发信号和所需抓取的数据。设置完毕ok，点击。添加完成后，在ISE界面的过程管理区双击Generate Programming File，完成工程得综合、翻译。布局布线、映射和产生输出文件。正确以后，双击Analyaze Design Using ChipScope，打开逻辑分析仪调试程序。 图6.5 编译并打开chipscope调试在连接JTAG Chain之前，首先必须确认FPGA仿真器连接到目标板上，目标板上电且仿真器连接正确以后，仿真器指示灯显示为绿色。确认以后，点击图标，连接仿真器。成功后，选中DEV：0MyDevice0，右键单击configure，勾选Clean previous project setting，OK。 图6.6 ChipScope Pro Analyzer界面 图6.7 Configure 图6.8 配置好的ChipScope Pro Analyzer配置好ChipScope Pro Analyzer，需要特别关注Trigger Setup和 Waveform这2个窗口，可以在Trigger Setup中设置触发条件，在Waveform中查看触发后的波形；工具栏中需特别关注：左起分别为触发（必需等待设置的触发状态到来）、停止触发、马上触发（不等待设置的触发状态是否到来，在当前状态立即触发）；利用这几个最常用的工具和其他一些工具可以完成带电调试FPGA，和DSP配合使用调试目标板。 百度搜索“就爱阅读”,专业资料,生活学习,尽在就爱阅读网92to.com,您的在线图书馆!
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众所周知，FPGA是可编程芯片，因此FPGA的设计方法包括硬件设计和软件设计两部分。硬件包括FPGA芯片电路、 存储器、输入输出接口电路以及其他设备，软件即是相应的HDL程序以及嵌入式C程序。
　　8. 板级仿真与验证　　板级仿真主要应用于高速中，对高速系统的信号完整性、电磁干扰等特征进行分析，一般都以第三方工具进行仿真和验证。　　9.芯片编程与调试　　设计的最后一步就是芯片编程与调试。芯片编程是指产生使用的数据文件（位数据流文件，Bitstream Generation），然后将编程数据下载到FPGA芯片中。其中，芯片编程需要满足一定的条件，如编程电压、编程时序和编程算法等方面。逻辑分析仪（Logic Analyzer，LA）是FPGA设计的主要调试工具，但需要引出大量的测试管脚，且LA价格昂贵。目前，主流的FPGA芯片生产商都提供了内嵌的在线逻辑分析仪（如Xilinx ISE中的ChipScope、Altera QuartusII中的SignalTapII以及SignalProb）来解决上述矛盾，它们只需要占用芯片少量的逻辑资源，具有很高的实用价值。
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