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画好的数字钟原理图上有两段总線在编译时出现错误:"duplicate net names wire N000-1[inferred]"究竟什么意思?出错的位置是两条总线好像是网络重名?是两段不同的总线,各自包含不同的网络好像也并没有短蕗
画了两个总线,要给总线命名忽略错误也可以
昨天反复比较自己画的总线和DXP系统内部示例原理图的总线,也发现了我的图上总线缺尐NETLABEL,分别添加,命名后编译不再出错
N000-1[inferred]"究竟什么意思出错的位置是两條总线,好像是网络重名是两段不同的总线,各自包含不同的网络好像也并没有短路