程序包说明条件语句的一般格式格式是怎样的?

来源：蜘蛛抓取(WebSpider) 时间：2018-06-30 10:51 标签： 条件语句的一般格式

第6章 VHDL硬件描述语言 ;本章要点 ??? VHDL语言嘚数据结构 ??? VHDL语言的顺序语句和并行语句 ????VHDL程序设计 ;6.1 VHDL概述 ; 用VHDL设计电路主要的工作过程是： 编辑 、编译、功能仿真（前仿真）、综合 、布局、布線 、后仿真（时序仿真） ;【例6-1】用VHDL设计一个非门（反向器）。 非门即 y = 这是一个完整的VHDL源程序实例其中的第一部分是库和程序包，是用VHDL編写的共享文件定义结构体和实体中要用到的数据类型、元件、子程序等，放在名为IEEE的库中第二部分是实体，相当于定义电路单元的管脚信息第三部分是结构体，用来描述电路的内部结构和逻辑功能两条短划线是注释标识符，其右侧内容是对程序的具体注释并不執行。所有语句都是以“；”结束另外程序中不区分字母的大小写。 ;6.1.3 VHDL的库和程序包 ;程序包格式如下 包头格式：PACKAGE 程序包名 IS [包头说明语句] END 程序包名； 包体格式： PACKAGE BODY 程序包名 IS [包体说明语句] END 程序包名； 调用程序包的通用模式为：USE 库名.程序包名.ALL； 常用预定义程序包有以下四个： （1）STD_LOGIC_1164程序包 端口说明也是实体说明的一个可选项，负责对实体中输入和输出端口进行描述端口说明语句格式如下： PORT（端口信号名1：端口模式1 數据类型1； ……； 端口信号名n：端口模式n 数据类型n）； ;6.1.5 VHDL的结构体 ;【例6-4】通过中间信号m实现输入端到输出端的数据传输。 ENTITY mybody IS --实体名为mybody PORT( in1 ：IN BIT； VHDL的数據结构 ;6.2.2 数据对象 VHDL中凡是可以赋予一个值的对象都可称为数据对象 1．常量 常量是在设计实体中保持某一特定值不变的量。常量的格式如下： CONSTANT 常量名：数据类型：= 表达式； 注意：数值和单位之间要留空格 常量一旦赋值之后在程序中就不能再改变了。常量的使用范围取决于被萣义的位置常量所赋的值应该与定义的表达式数据类型一致，否则将会出现错误 ;2．变量 变量属于局部量，主要用来暂存数据变量只能在进程和子程序中定义和使用，可

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