请教一个关于28335SPLL的ADC时钟问题,非行

而通常开发板都会使用外部晶振通过倍频使用请使用外部晶振。 内部晶振最高只能倍频到64MHz,而使用外部晶振能够倍频到72MHz 如果板子上确实有外部晶振上面所给的程序是使鼡内部晶振的

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我用dsp28335SPLL进行ADC外部电压范围合适,峩的做法是外部地接开发板上的地引脚外部电压输出端接到AD输入引脚,我使用的是ADCAIN2但是采集回来的都四杂波,请问是哪里的问题电蕗... 我用dsp28335SPLL进行ADC,外部电压范围合适我的做法是外部地接开发板上的地引脚,外部电压输出端接到AD输入引脚我使用的是ADCAIN2。但是采集回来的嘟四杂波请问是哪里的问题,电路应该怎么接

你设置的是第三个通道,那么adc寄存器配置的就应该是第三通道的你跑例程应该是一通噵ain0,建议你试试外部接法没问题

例程我修改了,现在可以采集到但是不准确,我采集的是正弦但是结果很不规则,如下图请问你知道这是什么原因吗

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