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用cpuid指令获取cpu信息
最近在写一个获取系统信息的Delphi组件，想得倒Cpu的id时，碰到了麻烦。上网查了好多资料，下了好多代码，结果还是没有解决问题，关于取Cpu的Id 众说纷纭，而且我试了好多，好像在几台机器上读到的CpuId好像都一样，（开发组机的机器，配置都一样，cpu当然也是一个型号的p4 1.8）。可cpu的id不应该一样吧，每个cpu应该有个唯一标识吧，笔者这样认为。
万般无奈，只好上INTEL的网站上看看了。下了一个关于cpuid简介的，郁闷的是，它是e文的，没办法啊，硬着头皮看了。
原来，读cpu的信息只需要一条汇编指令 cupid ,入口参数在EAX寄存器，返回的信息在EAX，EBX，ECX，EDX寄存器，也就是说执行cupid之前先给EAX寄存器赋值，在执行cupid，执行过之后，cpu的相关信息就在EAX，EBX，ECX，EDX寄存器中了，入口参数EAX
值设的不同，取得的信息也不同，我们可以写这样一个函数来获得Cpu的相关信息，当然也包括Id。
&&type &&&&TCPUIDResult&=&record &&&&&&eax&:&dword; &&&&&&ebx&:&dword; &&&&&&ecx&:&dword; &&&&&&edx&:&dword; &&&&end; &&function&CPUID(EAX:DWord):&TCPUIDResult; &&&&var&s1,s2,s3,s4:DWord; &&begin &&&&asm &&&&&&push&eax &&&&&&push&ebx &&&&&&push&ecx &&&&&&push&edx &&&&&&mov&&eax,EAX &&&&&&//****************************************************** &&&&&&//cpuid指令，因为Delphi的汇编编译器没有内置该指令， &&&&&&//所以用该指令的机器语言代码$0F,$A2来实现 &&&&&&//****************************************************** &&&&&&//db&$0F,$A2 &&&&&&//很多资料都这样说，但我发现Delphi6是支持cpuid这条指令的。 &&&&&&cpuid &&&&&&mov&s1,EAX &&&&&&mov&s2,EBX &&&&&&mov&s3,EcX &&&&&&mov&s4,Edx &&&&&&pop&edx &&&&&&pop&ecx &&&&&&pop&ebx &&&&&&pop&eax &&end; &&&&Result.EAX:=s1; &&&&Result.EBX:=s2; &&&&Result.EcX:=s3; &&&&Result.EdX:=s4; &&end;
Intel是这样规定的：
也就是说，EAX传入3时获得是Cpuid，可为什么笔者获得的几台机器的cpuid是相同的呢？
Intel是这样解释的：
自英特尔 486 问世以来，英特尔制造的每一款处理器都可以通过处理器设计过程中生成的 CPUID 字符串来辨别真伪（&真品英特尔& 处理器&）。然而，仅有少数几款含有附加 64　位（作为 CPUID 字符串的一部分）的处理器可以唯一识别。英特尔是在设计和 的过程中指定的　96　位固定编码。CPUID 涉及了处理器的信息，可依据产品系列（例如奔腾或赛扬& 处理器）和制造工艺（例如　0.13 或　0.18 微米）划分处理器。在正常　32　位上就创建了处理器的序列号。这个编号是固定的，不由于系统的改变而变化。有关读取编号的详情，请参阅 The 和　0.13 微米工艺的奔腾　III　处理器版本不支持随奔腾 III　处理器而引入的序列号功能。虽然无法唯一识别其它的处理器，但可以使用来获取&真品英特尔&和步进等信息。要从处理器封装上的标记信息识别一款处理器，请使用
这下问题解决了，笔者在这个过程中学到了不少都西，关于Cpuid指令的使用，也在网上搜到了不少资料，在这里稍稍总结以下，供大家参考：
CPUID参数及返回值列表： EAX= h 输入 EAX=h 得到CPUID指令所支持的最大值和厂家的名称字符串 输出 EAX=xxxx_xxxxh 得到CPUID指令所支持的最大值 #1 EBX-EDX-ECX 厂家的名称字符串 #2 GenuineIntel Intel 处理器 UMC UMC UMC UMC 处理器 AuthenticAMD AMD 处理器 CyrixInstead Cyrix 处理器 NexGenDriven NexGen 处理器 CentaurHauls Centaur 处理器 RiseRiseRise Rise Technology 处理器 GenuineTMx86 Transmeta 处理器 Geode by NSC National Semiconductor 处理器 说明 描述 #1 pre-B0 step Intel P5 处理器返回 EAX=0000_05xxh. #2 pre-B0 step Intel P5 处理器不能返回厂商字符串 EAX= h 输入 EAX=h 得到处理器 type/family/model/stepping和 面貌标识 输出 EAX=xxxx_xxxxh 处理器 type/family/model/stepping extended family extended family 是 bits 27..20. 00h Intel P4 01h Intel Itanium 2 (IA-64) extended model extended model 是 bits 19..16. type type是 bit 13 和 bit 12. 11b 保留 10b 第二块处理器 01b Overdrive 处理器 00b 第一处理器 family family是bits 11..8. 4 most 80486s AMD 5x86 Cyrix 5x86 5 Intel P5, P54C, P55C, P24T NexGen Nx586 Cyrix M1 AMD K5, K6 Centaur C6, C2, C3 Rise mP6 Transmeta Crusoe TM3x00 and TM5x00 6 Intel P6, P2, P3 AMD K7 Cyrix M2, VIA Cyrix III 7 Intel Itanium (IA-64) F 如果是这个值的话就看extended family model model 是 bits 7..4. Intel F 如果是这个值的话就看 extended model Intel 486DX-25/33 1 i80486DX-50 2 i80486SX 3 i80486DX2 4 i80486SL 5 i80486SX2 7 i80486DX2WB 8 i80486DX4 9 i80486DX4WB UMC D 2 U5S AMD 86DX2 7 80486DX2WB 8 80486DX4 9 80486DX4WB E 5x86 F 5x86WB Cyrix 5x86 9 5x86 Cyrix MediaGX 4 GX, GXm Intel P5-core 0 P5 A-step 1 P5 2 P54C 3 P24T Overdrive 4 P55C 7 P54C 8 P55C (0.25&m) NexGen Nx586 0 Nx586 or Nx586FPU (only later ones) Cyrix M1 2 6x86 Cyrix M2 0 6x86MX VIA Cyrix III 5 Cyrix M2 core 6 WinChip C5A core 7 WinChip C5B core (if stepping = 0..7) 7 WinChip C5C core (if stepping = 8..F) 8 WinChip C5C-T core (if stepping = 0..7) AMD K5 0 SSA5 (PR75, PR90, PR100) 1 5k86 (PR120, PR133) 2 5k86 (PR166) 3 5k86 (PR200) AMD K6 6 K6 (0.30 &m) 7 K6 (0.25 &m) 8 K6-2 9 K6-III D K6-2+ or K6-III+ (0.18 &m) Centaur 4 C6 8 C2 9 C3 Rise 0 mP6 (0.25 &m) 2 mP6 (0.18 &m) Transmeta 4 Crusoe TM3x00 and TM5x00 Intel P6-core 0 P6 A-step 1 P6 3 P2 (0.28 &m) 5 P2 (0.25 &m) 6 P2 with on-die L2 cache 7 P3 (0.25 &m) 8 P3 (0.18 &m) with 256 KB on-die L2 cache A P3 (0.18 &m) with 1 or 2 MB on-die L2 cache B P3 (0.13 &m) with 256 or 512 KB on-die L2 cache AMD K7 1 Athlon (0.25 &m) 2 Athlon (0.18 &m) 3 Duron (SF core) 4 Athlon (TB core) 6 Athlon (PM core) 7 Duron (MG core) 8 Athlon (TH core) A Athlon (Barton core) Intel P4-core 0 P4 (0.18 &m) 1 P4 (0.18 &m) 2 P4 (0.13 &m) 3 P4 (0.09 &m) stepping stepping 在 bits 3..0.
Stepping描述的是处理器的细节. EBX=aall_ccbbh brand ID brand ID是 7..0. 00h 不支持 01h 0.18 &m Intel Celeron 02h 0.18 &m Intel Pentium III 03h 0.18 &m Intel Pentium III Xeon 03h 0.13 &m Intel Celeron 04h 0.13 &m Intel Pentium III 07h 0.13 &m Intel Celeron mobile 06h 0.13 &m Intel Pentium III mobile 0Ah 0.18 &m Intel Celeron 4 08h 0.18 &m Intel Pentium 4 09h 0.13 &m Intel Pentium 4 0Eh 0.18 &m Intel Pentium 4 Xeon 0Bh 0.18 &m Intel Pentium 4 Xeon MP 0Bh 0.13 &m Intel Pentium 4 Xeon 0Ch 0.13 &m Intel Pentium 4 Xeon MP 08h 0.13 &m Intel Celeron 4 mobile 0Eh 0.13 &m Intel Pentium 4 mobile (production) 0Fh 0.13 &m Intel Pentium 4 mobile (samples) CLFLUSH CLFLUSH (8-byte)在 bits 15..8. CPU count 逻辑处理器数量 bits 23..16. APIC ID 默认（固定的）APIC ID是bits 31..24. ECX=xxxx_xxxxh feature flags 描述 bits 31...11 保留 bit 10 (CID) context ID: L1数据缓存能被设置成适应或共享模式 bit 9 保留 bit 8 (TM2) 热量监控 2 bit 7 保留 bit 6 保留 bit 5 保留 bit 4 (DSCPL) CPL-qualified Debug Store bit 3 (MON) 监控器 bit 2 保留 bit 1 保留 bit 0 (SSE3) SSE3, MXCSR, CR4.OSXMMEXCPT, #XF, 如果FPU=1也支持 FISTTP EDX=xxxx_xxxxh 面貌标志 说明 bit 31 (PBE) Pending Break Event, STPCLK, FERR#, MISC_ENABLE MSR bit 30 (IA-64) IA-64 bit 29 (TM) THERM_INTERRUPT, THERM_STATUS, and MISC_ENABLE MSRsxAPIC thermal LVT entry bit 28 (HTT) Hyper-Threading Technology bit 27 (SS) selfsnoop bit 26 (SSE2) SSE2, MXCSR, CR4.OSXMMEXCPT, #XF bit 25 (SSE) SSE, MXCSR, CR4.OSXMMEXCPT, #XF bit 24 (FXSR) FXSAVE/FXRSTOR, CR4.OSFXSR bit 23 (MMX) MMX bit 22 (ACPI) THERM_CONTROL MSR bit 21 (DTES) Debug Trace and EMON Store MSRs bit 20 保留 bit 19 (CLFL) CLFLUSH bit 18 (PSN) PSN (see standard EAX＝l h), PSN_DISABLE MSR #1 bit 17 (PSE36) 4 MB PDE bits 16..13, CR4.PSE bit 16 (PAT) PAT MSR, PDE/PTE.PAT bit 15 (CMOV) CMOVcc, if FPU=1 then also FCMOVcc/F(U)COMI(P) bit 14 (MCA) MCG_*/MCn_* MSRs, CR4.MCE, #MC bit 13 (PGE) PDE/PTE.G, CR4.PGE bit 12 (MTRR) MTRR* MSRs bit 11 (SEP) SYSENTER/SYSEXIT, SEP_* MSRs#2 bit 10 保留 bit 9 (APIC) APIC #3, #4 bit 8 (CX8) CMPXCHG8B #5 bit 7 (MCE) MCAR/MCTR MSRs, CR4.MCE, #MC bit 6 (PAE) 64bit PDPTE/PDE/PTEs, CR4.PAE bit 5 (MSR) MSRs, RDMSR/WRMSR bit 4 (TSC) TSC, RDTSC, CR4.TSD (doesn''t imply MSR=1) bit 3 (PSE) PDE.PS, PDE/PTE.res, CR4.PSE, #PF(1xxxb) bit 2 (DE) CR4.DE, DR7.RW=10b, #UD on MOV from/to DR4/5 bit 1 (VME) CR4.VME/PVI, EFLAGS.VIP/VIF, TSS32.IRB bit 0 (FPU) FPU 说明 说明 #1 如果PSN无效PSN 面貌标志就是0. #2 尽管Intel P6 处理器不支持 SEP,在这里仍然会虚报（真不知Intel是怎么想的）. #3 APIC无效那么APIC面貌标志就是0. #4 早期AMD K5 处理器 (SSA5)会假报支持 PGE. #5 处理器确实支持 CMPXCHG8B但默认却是报告不支持. 其实这是Windows NT的一个Bug. EAX= h 输入 EAX=h 得到处理器配置描述 输出 EAX.15..8 EAX.23..16 EAX.31..24 EBX.0..7 EBX.15..8 EBX.23..16 EBX.31..24 ECX.0..7 ECX.15..8 ECX.23..16 ECX.31..24 EDX.0..7 EDX.15..8 EDX.23..16 EDX.31..24 配置描述 值 说明 00h null descriptor (=unused descriptor) 01h code TLB, 4K pages, 4 ways, 32 entries 02h code TLB, 4M pages, fully, 2 entries 03h data TLB, 4K pages, 4 ways, 64 entries 04h data TLB, 4M pages, 4 ways, 8 entries 06h code L1 cache, 8 KB, 4 ways, 32 byte lines 08h code L1 cache, 16 KB, 4 ways, 32 byte lines 0Ah data L1 cache, 8 KB, 2 ways, 32 byte lines 0Ch data L1 cache, 16 KB, 4 ways, 32 byte lines 10h data L1 cache, 16 KB, 4 ways, 32 byte lines (IA-64) 15h code L1 cache, 16 KB, 4 ways, 32 byte lines (IA-64) 1Ah code and data L2 cache, 96 KB, 6 ways, 64 byte lines (IA-64) 22h code and data L3 cache, 512 KB, 4 ways (!), 64 byte lines, dual-sectored 23h code and data L3 cache, 1024 KB, 8 ways, 64 byte lines, dual-sectored 25h code and data L3 cache, 2048 KB, 8 ways, 64 byte lines, dual-sectored 29h code and data L3 cache, 4096 KB, 8 ways, 64 byte lines, dual-sectored 39h code and data L2 cache, 128 KB, 4 ways, 64 byte lines, sectored 3Bh code and data L2 cache, 128 KB, 2 ways, 64 byte lines, sectored 3Ch code and data L2 cache, 256 KB, 4 ways, 64 byte lines, sectored 40h no integrated L2 cache (P6 core) or L3 cache (P4 core) 41h code and data L2 cache, 128 KB, 4 ways, 32 byte lines 42h code and data L2 cache, 256 KB, 4 ways, 32 byte lines 43h code and data L2 cache, 512 KB, 4 ways, 32 byte lines 44h code and data L2 cache, 1024 KB, 4 ways, 32 byte lines 45h code and data L2 cache, 2048 KB, 4 ways, 32 byte lines 50h code TLB, 4K/4M/2M pages, fully, 64 entries 51h code TLB, 4K/4M/2M pages, fully, 128 entries 52h code TLB, 4K/4M/2M pages, fully, 256 entries 5Bh data TLB, 4K/4M pages, fully, 64 entries 5Ch data TLB, 4K/4M pages, fully, 128 entries 5Dh data TLB, 4K/4M pages, fully, 256 entries 66h data L1 cache, 8 KB, 4 ways, 64 byte lines, sectored 67h data L1 cache, 16 KB, 4 ways, 64 byte lines, sectored 68h data L1 cache, 32 KB, 4 ways, 64 byte lines, sectored 70h trace L1 cache, 12 K&OPs, 8 ways 71h trace L1 cache, 16 K&OPs, 8 ways 72h trace L1 cache, 32 K&OPs, 8 ways 77h code L1 cache, 16 KB, 4 ways, 64 byte lines, sectored (IA-64) 79h code and data L2 cache, 128 KB, 8 ways, 64 byte lines, dual-sectored 7Ah code and data L2 cache, 256 KB, 8 ways, 64 byte lines, dual-sectored 7Bh code and data L2 cache, 512 KB, 8 ways, 64 byte lines, dual-sectored 7Ch code and data L2 cache, 1024 KB, 8 ways, 64 byte lines, dual-sectored 7Eh code and data L2 cache, 256 KB, 8 ways, 128 byte lines, sect. (IA-64) 81h code and data L2 cache, 128 KB, 8 ways, 32 byte lines 82h code and data L2 cache, 256 KB, 8 ways, 32 byte lines 83h code and data L2 cache, 512 KB, 8 ways, 32 byte lines 84h code and data L2 cache, 1024 KB, 8 ways, 32 byte lines 85h code and data L2 cache, 2048 KB, 8 ways, 32 byte lines 88h code and data L3 cache, 2048 KB, 4 ways, 64 byte lines (IA-64) 89h code and data L3 cache, 4096 KB, 4 ways, 64 byte lines (IA-64) 8Ah code and data L3 cache, 8192 KB, 4 ways, 64 byte lines (IA-64) 8Dh code and data L3 cache, 3096 KB, 12 ways, 128 byte lines (IA-64) 90h code TLB, 4K...256M pages, fully, 64 entries (IA-64) 96h data L1 TLB, 4K...256M pages, fully, 32 entries (IA-64) 9Bh data L2 TLB, 4K...256M pages, fully, 96 entries (IA-64) 值 描述 70h Cyrix specific: code and data TLB, 4K pages, 4 ways, 32 entries 74h Cyrix specific: ??? 77h Cyrix specific: ??? 80h Cyrix specific: code and data L1 cache, 16 KB, 4 ways, 16 byte lines 82h Cyrix specific: ??? 84h Cyrix specific: ??? 值 描述 others 保留 举个例子有一块 P6 EAX=h EBX=h ECX=h EDX=h 这块P6处理器包含4K/M code/data TLB,8+8 KB code/data L1 cache 和混合 512 KB code/data L2 cache. 说明 说明 #1 在多处理器系统中要特别注意，应该执行. EAX=h 输入 EAX=h 得到处理器序列号 #1 输出 EBX=xxxx_xxxxh 处理器序列号(只只是Transmeta Crusoe) ECX=xxxx_xxxxh 处理器序列号 EDX=xxxx_xxxxh 处理器序列号 说明 说明 #1 仅当PSN有效时. EAX＝ h 输入 EAX=h 得到扩展CPUID指令所支持的最大值和厂家的名称字符串 输出 EAX=xxxx_xxxxh 最大值EBX-EDX-ECX 厂家的名称字符串 AuthenticAMD AMD 保留 Cyrix 保留 Centaur 保留 Intel TransmetaCPU Transmeta 保留 National Semiconductor extended EAX＝ h 输入 EAX=h 得到处理器 family/model/stepping and features flags #0 输出 EAX=0000_0xxxh 处理器 family/model/stepping family Family是 bits 11..8. 5 AMD K5 Centaur C2 Transmeta Crusoe TM3x00 and TM5x00 6 AMD K6 VIA Cyrix III 7 AMD K7 model model 是bits 7..4. AMD K5 1 5k86 (PR120 or PR133) 2 5k86 (PR166) 3 5k86 (PR200) AMD K6 6 K6 (0.30 &m) 7 K6 (0.25 &m) 8 K6-2 9 K6-III D K6-2+ or K6-III+ (0.18 &m) AMD K7 1 Athlon (0.25 &m) 2 Athlon (0.18 &m) 3 Duron (SF core) 4 Athlon (TB core) 6 Athlon (PM core) 7 Duron (MG core) 8 Athlon (TH core) A Athlon (Barton core) Centaur 8 C2 9 C3 VIA Cyrix III 5 Cyrix M2 core 6 WinChip C5A core 7 WinChip C5B core (if stepping = 0..7) 7 WinChip C5C core (if stepping = 8..F) 8 WinChip C5C-T core (if stepping = 0..7) Transmeta 4 Crusoe TM3x00 and TM5x00 stepping stepping是bits 3..0. Stepping的值是处理器的细节. EDX=xxxx_xxxxh feature flags description of indicated feature bit 31 (3DNow!) 3DNow! bit 30 (3DNow!+) extended 3DNow! bit 29 (LM) AA-64, Long Mode（也就是AMD的X86-64指令集） bit 28 保留 bits 27..25 保留 bit 24 (MMX+) bit 24 (FXSR) Cyrix specific: extended MMX AMD K7: FXSAVE/FXRSTOR, CR4.OSFXSR bit 23 (MMX) MMX bit 22 (MMX+) AMD specific: MMX-SSE and SSE-MEM bit 21 保留 bit 20 (NX) EFER.NXE, P?E.NX, #PF(1xxxx) bit 19 (MP) MP-capable #3 bit 18 保留 bit 17 (PSE36) 4 MB PDE bits 16..13, CR4.PSE bit 16 (FCMOV) bit 16 (PAT) FCMOVcc/F(U)COMI(P) (implies FPU=1) AMD K7: PAT MSR, PDE/PTE.PAT bit 15 (CMOV) CMOVcc bit 14 (MCA) MCG_*/MCn_* MSRs, CR4.MCE, #MC bit 13 (PGE) PDE/PTE.G, CR4.PGE bit 12 (MTRR) MTRR* MSRs bit 11 (SEP) SYSCALL/SYSRET, EFER/STAR MSRs #1 bit 10 保留 #1 bit 9 (APIC) APIC #2 bit 8 (CX8) CMPXCHG8B bit 7 (MCE) MCAR/MCTR MSRs, CR4.MCE, #MC bit 6 (PAE) 64bit PDPTE/PDE/PTEs, CR4.PAE bit 5 (MSR) MSRs, RDMSR/WRMSR bit 4 (TSC) TSC, RDTSC, CR4.TSD (doesn''t imply MSR=1) bit 3 (PSE) PDE.PS, PDE/PTE.res, CR4.PSE, #PF(1xxxb) bit 2 (DE) CR4.DE, DR7.RW=10b, #UD on MOV from/to DR4/5 bit 1 (VME) CR4.VME/PVI, EFLAGS.VIP/VIF, TSS32.IRB bit 0 (FPU) FPU 说明 内容 #0 Intel 处理器不支持; 返回值EAX, EBX, ECX, 和 EDX都是0. #1 AMD K6 处理器, model 6, uses 使用第十位指示SEP. #2 如果APIC是无效的,那么APIC读到的是0. #3 AMD CPUID=0662h的K7 处理器如果是具有多处理器能力的版本可能也报告时0 EAX＝ h, h, and h 输入 EAX=h 得到处理器名称的第一部分 EAX=h 得到处理器名称的第二部分 EAX=h 得到处理器名称的第三部分
输出 EAX EBX ECX EDX 处理器名称字符串#1 AMD K5 AMD-K5(tm) 处理器 AMD K6 AMD-K6tm w/ multimedia extensions AMD K6-2 AMD-K6(tm) 3D 处理器 AMD-K6(tm)-2 处理器 AMD K6-III AMD-K6(tm) 3D+ 处理器 AMD-K6(tm)-III 处理器 AMD K6-2+ AMD-K6(tm)-III 处理器 (?) AMD K6-III+ AMD-K6(tm)-III 处理器 (?) AMD K7 AMD-K7(tm) 处理器 (model 1) AMD Athlon(tm) 处理器 (model 2) AMD Athlon(tm) 处理器 (models 3/4, 6/7, and 8 -- programmable) Centaur C2 #2 IDT WinChip 2 IDT WinChip 2-3D VIA Cyrix III CYRIX III(tm) (?) VIA Samuel (?) VIA Ezra (?) Intel P4 Intel(R) Pentium(R) 4 CPU xxxxMHz (right-justified, leading whitespaces)顺便说一句，Intel只有P4以上才支持。 Transmeta Transmeta(tm) Crusoe(tm) 处理器 TMxxxx 说明 内容 #1 是一个字符数组，以0H结尾. #2 WinChip是否支持决定于是否支持3D Now！. EAX＝ h 输入 EAX=h 得到L1缓存容量和入口数量 #1 输出 EAX 4/2 MB L1 入口信息 EAX的位 描述 31..24 data TLB associativity (FFh=full) 23..16 data TLB entries 15..8 code TLB associativity (FFh=full) 7..0 code TLB entries EBX 4 KB L1入口信息 bits description 31..24 data TLB associativity (FFh=full) 23..16 data TLB entries 15..8 code TLB associativity (FFh=full) 7..0 code TLB entries ECX data L1 信息描述 bits description 31..24 data L1 cache size in KBs 23..16 data L1 cache associativity (FFh=full) 15..8 data L1 cache lines per tag 7..0 data L1 cache line size in bytes EDX code L1信息描述 bits description 31..24 code L1 cache size in KBs 23..16 code L1 cache associativity (FFh=full) 15..8 code L1 cache lines per tag 7..0 code L1 cache line size in bytes 说明 description #1 Cyrix 处理器使用h做类似的描述 EAX= h 输入 EAX=h 得到L1缓存容量和入口数量 输出 EAX 4/2 MB L2 入口信息 #1 位 描述 31..28 data TLB associativity #2 27..16 data TLB entries 15..12 code TLB associativity #2 11..0 code TLB entries EBX 4 KB L2 入口信息 位 描述 31..28 data TLB associativity #1 27..16 data TLB entries 15..12 code TLB associativity #1 11..0 code TLB entries ECX 统一 L2 cache 信息 #32 bits description 31..16 #4 unified L2 cache size in KBs #3 15..12 #4 unified L2 cache associativity #1 11..8 #4 unified L2 cache lines per tag 7..0 unified L2 cache line size in bytes 说明 描述 #1 0000b=L2 off, 0001b=direct mapped, 0010b=2-way, 0100b=4-way, 0110b=8-way, 1000b=16-way, 1111b=full #2 AMD K7 处理器 L2 cache 必须依赖于此信息. #3 AMD PUID=0630h 的K7 处理器(Duron) 具有 64 KB二级缓存，但是却报告只有1KB. #4 VIA Cyrix III CPUID=Fh (C5B/C5C)的处理器错误报告bits 31..24, 23..16, and 15..8. EAX h 输入 EAX=h 电源管理信息(EPM) 输出 EDX EPM flags 位 说明 31..3 保留 2 (VID) voltage ID control supported 1 (FID) frequency ID control supported 0 temperature sensing diode supported EAX＝ h 输入 EAX=h 得到地址大小信息 输出 EAX 地址大小信息 位 说明 31..16 保留 15..8 virtual address bits 7..0 physical address bits Transmeta EAX＝ h 输入 EAX=h 得到CPUID的最大支持和厂商字符串 输出 EAX=xxxx_xxxxh 最大支持 EAX＝l EBX-EDX-ECX 厂商字符串 TransmetaCPU Transmeta processor Transmeta EAX＝ h 输入 EAX=h 得到处理器信息 输出 EAX=0000_0xxxh 处理器信息 family The family is encoded in bits 11..8. 5 Transmeta Crusoe TM3x00 and TM5x00 model The model is encoded in bits 7..4. Transmeta 4 Crusoe TM3x00 and TM5x00 stepping The stepping is encoded in bits 3..0. The stepping values are processor-specific. EBX=aabb_ccddh hardware revision (a.b-c.d), if h: see EAX＝l h register EAX instead ECX=xxxx_xxxxh nominal core clock frequency (MHz) EDX=xxxx_xxxxh feature flags description of indicated feature bits 31..4 reserved bit 3 (LRTI) LongRun Table Interface bit 2 (???) unknown bit 1 (LR) LongRun bit 0 (BAD) recovery CMS active (due to a failed upgrade) Transmeta EAX＝ h 输入 EAX=h 得到处理器信息 输出 EAX xxxx_xxxxh reserved or hardware revision (xxxxxxxxh) see EAX＝l h register EBX for details EBX aabb_ccddh software revision, part 1/2 (a.b.c-d-x) ECX xxxx_xxxxh software revision, part 2/2 (a.b.c-d-x) Transmeta EAX＝h, h, h, and h 输入 EAX=h 得到信息字符串第一部分 EAX=h 得到信息字符串第一部分 EAX=h 得到信息字符串第一部分 EAX=h 得到信息字符串第一部分 输出 EAX-EBX-ECX-EDX 信息字符串 #1 Transmeta :30 official release 4.1.4#2 (例子) 说明 说明 #1 以00h为结尾的字符串. Transmeta EAX＝ h 输入 EAX=h 得到处理器信息 输出 EAX xxxx_xxxxh 当前时钟频率 (MHz) EBX xxxx_xxxxh 当前电压 (mV) ECX xxxx_xxxxh 当前占用率 (0..100%) EDX xxxx_xxxxh 当前的延迟 (fs) 神秘的功能 EAX＝ 8FFF_FFFEh 输入 EAX=8FFF_FFFEh 未知 #1 输出 EAX h DEI (according to one source: Divide Et Impera = Divide And Rule) EBX h 保留 ECX h 保留 EDX h 保留 说明 说明 #1 这个方法仅仅被 AMD K6 支持. 神秘的功能EAX＝ 8FFF_FFFFh 输入 EAX=8FFF_FFFFh 未知 #1 输出 EAX EBX ECX EDX string NexGenerationAMD 说明 说明 #1 这个方法只被he AMD K6支持. 其他 输入 EAX=xxxx_xxxxh 其他 输出 EAX=xxxx_xxxxh EBX=xxxx_xxxxh ECX=xxxx_xxxxh EDX=xxxx_xxxxh 不明确&&
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Intel 奔腾双核 E6300(盒)参考价格：停产(最后一次报价￥100)本周成交：2笔关注热度：8人上市时间：2000年01月相关信息：
CPU频率：2.8GHz | CPU核心：双核 | 接口类型：LGA 775 | 制程工艺：45纳米 | 二级缓存：2MB | 核心类型：Wolfdale | 工作功率：65W
大学生分期购物销量榜
总结：大家的E6300有没有散热问题啊？室温30的时候空载就跑到48度了。满载竟然高达96度！我的全原装…包括散热片和风扇优点：2级缓存2m，45纳米制成，超频能力很强，对于一般用户来说这个价钱不算太高！在超频的情况下稳定性也很强！不超的情况下2.7的主频足够以一般用户的使用！不足：一级缓存只有可怜的64kb……原装风扇实在不敢恭维~！~~~总结：值...优点：性能就不说了，非常不错。超频能力也好，风冷下轻松上4.5不足：价格高，没搞懂为什么比E83贵这么多，性价比不够总结：喜欢还是可以买的，但是更推荐E83优点：超频能力强，配个好主板，可以搭建一个非常好的平台。不足：性价比低，原装风扇噪音比较大，换个散装比较好，但又得添加一笔费用。总结：够用的产品，但性价比实在太低。和pentium系列相比就是多了1mb二级缓存，但价格却高了...优点：超频后稳定 速度快 温度低 真的很不错的CPU。我是用微型P45T―C51主板的自动超频超的。一直稳定运行在3.6G。这个速度我觉得已经完全应付我的工作了。对了，我用的是散装的U+酷冷至尊Z200的风扇，机箱酷冷毁灭者。...
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飞速演进的计算和通信技术彻底改变了这个世界，使人们不再因时间、空间、设备等壁垒而相互隔绝，地球变得越来越小。英特尔正在与产业界的其他合...
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